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TMS320C6678 存儲器訪問性能 (上)

2015年06月18日16:45:00 本網站 我要評論(2)字號:T | T | T
關鍵字:3G 

摘要


TMS320C6678 有8 個C66x 核,典型速度是1GHz,每個核有 32KB L1D SRAM,32KB L1P SRAM 和 512KB LL2 SRAM;所有 DSP 核共享 4MB SL2 SRAM。一個 64-bit 1333MTS DDR3 SDRAM 接口可以支持8GB 外部擴展存儲器。

 

存儲器訪問性能對 DSP 上運行的軟件是非常關鍵的。在 C6678  DSP 上,所有的主模塊,包括多個DSP 核和多個DMA 都可以訪問所有的存儲器。

 

每個DSP 核每個時鐘周期都可以執行較多128 bits 的load 或store 操作。在1GHz  的時鐘頻率下,DSP 核訪問L1D SRAM 的帶寬可以達到16GB/S。

 

DSP 的內部總線交換網絡,TeraNet,提供了 C66x  核(包括其本地存儲器),外部存儲器, EDMA 控制器,和片上外設之間的互連總共有 10 個 EDMA 傳輸控制器可以被配置起來同時執行任意存儲器之間的數據傳輸。

 

本文為設計人員提供存儲器訪問性能評估的基本信息;提供各種操作條件下的性能測試數據;還探討了影響存儲器訪問性能的一些因素。

 

1.  存儲器系統簡介       

                                                    

TMS320C6678 有8 個C66x 核,每個核有:

·32KB L1D (Level 1 Data) SRAM,它和DSP 核運行在相同的速度上,可以被用作普通的數據存儲器或數據cache。

·32KB L1P (Level 1 Program) SRAM,它和DSP 核運行在相同的速度上,可以被用作普通的程序存儲器或程序cache。

·512KB LL2 (Local Level 2) SRAM,它的運行速度是DSP 核的一半,可以被用作普通存儲器或cache,既可以存放數據也可以存放程序。

 

所有DSP 核共享4MB SL2 (Shared Level 2) SRAM,它的運行速度是DSP 核的一半,既可以存放數據也可以存放程序。

 

TMS320C6678 集成一個64-bit 1333MTS DDR3 SDRAM 接口,可以支持8GB 外部擴展存儲器,既可以存放數據也可以存放程序。它的總線寬度也可以被配置成32 bits 或16 bits。

 

存儲器訪問性能對 DSP 上軟件運行的效率是非常關鍵的。在 C6678 DSP 上,所有的主模塊,包括多個DSP 核和多個DMA 都可以訪問所有的存儲器。

 

每個DSP 核每個時鐘周期都可以執行較多128 bits 的load 或store 操作。在1GHz  的時鐘頻率下,DSP 核訪問 L1D SRAM 的帶寬可以達到 16GB/S。當訪問二級(L2)存儲器或外部存儲器時,訪問性能主要取決于訪問的方式和cache。

 

每個 DSP 核有一個內部 DMA (IDMA),在 1GHz  的時鐘頻率下,它能支持高達 8GB/秒的傳輸。但IDMA 只能訪問L1 和LL2 以及配置寄存器,它不能訪問外部存儲器。

 

DSP 的內部總線交換網絡,TeraNet,提供了 C66x 核 (包括其本地存儲器) ,外部存儲器, EDMA 控制器,和片上外設之間的互聯。總共有 10 個 EDMA 傳輸控制器可以被配置起來同時執行任意存儲器之間的數據傳輸。芯片內部有兩個主要的 TeraNet 模塊,一個用 128 bit 總線連接每個端點,速度是DSP 核頻率的1/3,理論上,在1GHz 的器件上每個端口支持  5.333GB/秒的帶寬;另一個 TeraNet 內部總線交換網絡用 256  bit 總線連接每個端點,速度是DSP 核頻率的1/2,理論上,在1GHz 的器件上每個端口支持16GB/秒的帶寬。

 

總共有10 個EDMA 傳輸控制器可以被配置起來同時執行任意存儲器之間的數據傳輸。它們中的兩個連接到256-bit, 1/2 DSP 核速度的 TeraNet 內部總線交換網絡;另外8 個連接到128-bit, 1/3 DSP 核速度的 TeraNet 內部總線交換網絡。

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